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(資料圖)

3 Skew講解

針對第2章節(jié)時序路徑中用到skew，在本章再仔細(xì)講解一下。

Skew分為兩種情況：一是positive skew（上升沿偏斜），一是negative skew（下降沿偏斜）。

positive skew（上升沿偏斜）可以參考下圖表示，實際上是增加了后一級寄存器的觸發(fā)時間。比如寄存器1產(chǎn)生數(shù)據(jù)后，寄存器2在Tclk+Tskew后才能采集到數(shù)據(jù)。

相比于positive skew（上升沿偏斜），negative skew（下降沿偏斜）相當(dāng)于減少了后一級寄存器的觸發(fā)時間，比如寄存器1產(chǎn)生數(shù)據(jù)后，寄存器2在Tclk-Tskew后就能采集到數(shù)據(jù)。可通過下圖理解：

針對于第2章FPGA時序約束理論篇講解的時序路徑（包括公式計算），可以用下面這個圖來表示時序關(guān)系就更加容易理解。其中直觀的表現(xiàn)了要減去Tskew的原因。

Tclk≥Tco+Tlogic+Troute+Tsetup-Tskew

NOTE:

1.在系統(tǒng)穩(wěn)定后，均是是positive skew的狀態(tài)，但即便是positive skew，綜合工具在計算時序時，也不會把多出來的Tskew算進(jìn)去。相當(dāng)于還是按照嚴(yán)格標(biāo)準(zhǔn)去滿足時序；

2.對于同步設(shè)計Tskew可忽略(認(rèn)為其值為0)，因為FPGA中的時鐘樹會盡量保證到每個寄存器的延遲相同。